fpga工程师
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经验不限本科Verilog HDLzynqps-pl协同开发逻辑设计FPGA开发/验证经验FPGA开发
一、岗位职责:负责FPGA及ZYNQ平台相关产品的逻辑设计、开发、调试与优化,聚焦ZYNQ芯片PS与PL协同开发,保障产品硬件逻辑稳定、高效运行,配合团队完成项目落地与技术迭代。 工作性质:全职 二、核心工作职责 1. 负责基于ZYNQ平台(如Zynq-7000、Zynq UltraScale+系列)的软硬件协同开发,包括PL端逻辑设计、PS端系统开发及PS-PL数据交互优化,熟练运用AXI-Lite/AXI-Stream接口、DMA数据传输等技术实现高效协同。 2. 负责FPGA逻辑设计与开发,使用Verilog/VHDL语言编写逻辑代码,完成IP核集成、时序约束、逻辑综合与时序收敛优化,合理分配FPGA内部LUT、BRAM、DSP等资源。 3. 负责ZYNQ平台相关驱动开发、操作系统(如Linux、PetaLinux)移植与裁剪,完成板级支持包(BSP)配置、设备树编写,以及UART、SPI、I2C、DDR、千兆以太网等常用接口的开发与调试。 4. 负责FPGA及ZYNQ相关产品的板级调试、系统联调,使用ILA/VIO等工具进行在线调试,定位并解决逻辑设计、接口通信、时序匹配等相关技术问题,确保产品稳定运行。 5. 参与项目需求分析、技术方案设计与评审,结合ZYNQ平台特性提出合理的技术优化建议,编写相关技术文档(设计文档、调试报告、用户手册等),建立完善的技术档案。 6. 跟进FPGA及ZYNQ相关技术发展趋势,学习最新开发工具与技术,优化开发流程,提升产品性能与开发效率;配合硬件团队完成原理图设计、PCB评审等相关工作。 7. 协助解决产品量产过程中的FPGA相关技术问题,提供技术支持;配合团队完成技术攻关、项目交付等相关工作,指导初级工程师开展开发调试工作。 三、任职要求 (一)学历与专业 1. 本科及以上学历,电子信息工程、通信工程、自动化、微电子、计算机等相关专业,有2年及以上FPGA开发经验,且具备完整的ZYNQ平台开发项目经验。 2. 熟悉ZYNQ开发流程和平台搭建,有工业控制、通信设备、图像处理等相关领域项目经验者优先。 (二)专业技能 1. 熟练掌握Verilog/VHDL硬件描述语言,具备扎实的数字电路、计算机组成原理基础,熟悉同步时序设计思想,能独立完成FPGA逻辑设计、时序约束与优化。 2. 精通ZYNQ平台架构,熟练使用Vivado开发工具,掌握PL端block design、IP集成、约束编写、时序收敛等操作,具备PS-PL协同开发与优化能力。 3. 熟悉嵌入式操作系统(Linux、PetaLinux等)的移植、裁剪与驱动开发,掌握SDK/SDSoc等开发工具,能独立完成设备树编写、驱动调试等工作。 4. 熟悉UART、SPI、I2C、DDR3/4、千兆以太网、PCIE等常用接口的开发与调试,具备高速接口开发经验者优先,能使用示波器、逻辑分析仪等工具进行硬件调试。 5. 掌握FPGA仿真与验证方法,能使用ModelSim等仿真工具编写testbench进行功能验证,具备良好的问题定位与解决能力,能快速排查逻辑、时序及接口相关故障。 6. 具备良好的英文阅读能力,能熟练阅读ZYNQ芯片及相关器件的英文数据手册,了解行业技术动态。
职位总结围绕职位描述,归纳工作内容、招聘要求

姚女士IP:江苏苏州
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思钛芯(苏州)科技有限公司
·人事经理工作地址:
苏州相城区相城长三角国际研发社区启动区1号楼A座
点击查看地图法定代表人:郑长林
成立日期:2025-11-24
