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5-10年本科C++VerilogPythonC/C++
岗位职责:
1、负责数字电路设计自动化(EDA)RTL综合工具的开发与维护;
2、参与技术方案评审及测试方案的评估工作;
3、完成所辖模块的设计文档与测试需求文档编写,并按计划交付对应模块成果;
任职要求:
1、计算机/电子工程等相关专业本科及以上学历,具备五年以上相关工作经验;
2、熟练掌握Linux环境下C/C++编程,熟悉现代C++开发规范,精通Python/Tcl/Perl中至少一种脚本语言;
3、熟悉Verilog/SystemVerilog/VHDL/SystemC/Chisel中一种或多种硬件描述语言;
4、有ASIC/FPGA综合工具或编译器开发经验者优先考虑;
5、对FPGA体系结构、工作原理或性能优化有深入理解者优先;
6、了解集成电路设计或验证流程者优先,具备硬件仿真加速经验者优先;
7、研究方向匹配的博士毕业生可放宽工作经验要求;
8、具备较强的逻辑分析与问题解决能力,乐于钻研新技术;
9、具备良好的英文文献阅读能力、算法理解能力以及团队协作精神。
职位总结围绕职位描述,归纳工作内容、招聘要求

肖女士IP:上海
启芯领航
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